实验二组合逻辑电路的设计与测试
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实验二 组合逻辑电路的设计与测试
一、实验目的
1、掌握组合逻辑电路的设计与测试方法
2、设计半加器和全加器并测试其逻辑功能
二.实验仪器及材料
器件:74LS00 二输入端四与非门 1片
74LS10 三输入端三与非门 1片
74LS86 二输入端四异或门 1片
三、实验原理
1、设计组合电路的一般步骤如图2-1所示。
图2-1 组合逻辑电路设计流程图
组合逻辑电路基本设计方法:
(1)根据设计任务的要求建立输入、输出变量,并列出真值表。
(2)然后用逻辑代数或卡诺图化简法求出简化的逻辑表达式。并按实际选用逻辑门的类型修改逻辑表达式
(3)根据简化后的逻辑表达式,画出逻辑图,用标准器件构成逻辑电路.
(4)最后,用实验来验证设计的正确性。
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2、 组合逻辑电路设计举例
设计任务: 用“与非"门设计一个四个人的表决电路。当四个输入端中有三个或四个为“1”时,输出端才为“1”。 (同意用"1"表示,反对用"0”表示;决议通过用”1"表示,不通过用"0"表示。)
设计步骤:
(1)根据题意列出真值表如表2-1所示,再填入卡诺图表2-2中。
表2-1
A
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
B
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
C
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
D
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
Z
0
0
0
0
0
0
0
1
0
0
0
1
0
1
1
1
表2-2
CD
AB
00
01
11
10
00
01
1
11
1
1
1
10
1
(2) 由卡诺
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