第六章 mcs-51单片机IO端口ppt课件.ppt

第六章MCS-51的I/0端口单片机I/O口的使用对单片机的控制,其实就是对I/O口的控制,无论单片机对外界进行何种控制,或接受外部的控制,都是通过I/O口进行的。51单片机总共有P0、P1、P2、P3四个8位双向输入输出端口,每个端口都有锁存器、输出驱动器和输入缓冲器。4个I/O端口都能作输入输出口用,其中P0和P2通常用于对外部存储器的访问。51系列单片机有4个I/O端口,每个端口都是8位准双向口,共占32根引脚。每个端口都包括一个锁存器(即专用寄存器P0~P3)、一个输出驱动器和输入缓冲器。通常把4个端口笼统地表示为P0~P3。在无片外扩展存储器的系统中,这4个端口的每一位都可以作为准双向通用I/O端口使用。在具有片外扩展存储器的系统中,P2口作为高8位地址线,P0口分时作为低8位地址线和双向数据总线。51单片机4个I/O端口线路设计的非常巧妙,学****I/O端口逻辑电路,不但有利于正确合理地使用端口,而且会给设计单片机外围逻辑电路有所启发。下面简单介绍一下输入/输出端口结构。(n=0~7)结构图,它由一个输出锁存器、两个三态输入缓冲器、一个输出驱动电路和一个输出控制电路组成。输出驱动电路由一对FET(场效应管)组成,其工作状态受输出控制电路的控制,后者包括:1个与门、1个反相器和1个模拟转换开关(MUX)。、P0口的结构1、P0口作为普通I/O口①输出时模拟转换开关的位置由来自CPU的控制信号决定,当控制信号为0(低电平)时,开关处于图示位置,它把输出级与锁存器的~Q端接通。同时,因为与门输出为0,输出级中的上拉FET处于截止状态,因此输出级是漏极开路的开漏电路。这时P0口可作一般的I/O口用。,写脉冲加在触发器时钟端CLK上,这样与内部总线相连的D端的数据取反后就出现在~Q端上,又经输出FET反相,在P0引脚上出现的数据正好是内部总线的数据。P0口的输出级可以驱动8个LSTTL输入,但在开漏状态下,为了驱动NMOS或其它拉流负载,需要外接上拉电阻。②输入时----分读引脚或读锁存器读引脚:由传送指令(MOV)实现;端口中的2个三态缓冲器用于读操作。一个缓冲器用于直接读端口引脚处的数据,当执行一般由端口输入的指令时,读脉冲把图中下面一个三态缓冲器打开,这样端口上的数据将经过缓冲器送至内部总线。/T1T2P0口引脚②输入时----分读引脚或读锁存器图中上面一个缓冲器并不直接读取端口引脚上的数据,而是读取锁存器Q端的数据。Q端与引脚处的数据是一致的。结构上这样安排是为了适应所谓“读-修改-写”类指令的需要。这类指令的特点是:先读口,随之可能对读入的数据进行修改,然后再写到端口上。例如逻辑与指令:ANLP0,A就属于这类指令。此指令先把P0上的数据读入CPU,随之与累加器A内的数据按位进行逻辑与操作,最后再把与的结果送回P0口。这类指令同样适用于P1~P3口。对于“读-修改-写”指令,不直接读引脚上的数据而读锁存器上的数据,是为了避免错读引脚上电平的可能性。例如,若用一根口线去驱动一个晶体管的基极,当向此口线写1时,晶体管导通,并把引脚上的电平拉低。这时若从引脚上读取数据,会把此数据(应为1)错读为0,若从锁存器Q端读取,则可以得到正确的数据。